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Questa
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Questa 驗(yàn)證解決方案徹底改變了驗(yàn)證方式，大大提高了驗(yàn)證效率并更有效地管理資源。Questa 以多種強(qiáng)大的技術(shù)為基礎(chǔ)，不斷發(fā)展以應(yīng)對日益復(fù)雜的 SoC 設(shè)計(jì)。

Questa 可自動驗(yàn)證和調(diào)試復(fù)雜的 SoC 和 FPGA，從而大幅提高生產(chǎn)效率并幫助公司更高效地管理資源。Questa 一流的技術(shù)可最大程度地提高模塊、子系統(tǒng)和系統(tǒng)級別的驗(yàn)證效率。
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Questa 的核心仿真和調(diào)試引擎
QuestaSim 是 Questa 驗(yàn)證解決方案的核心仿真和調(diào)試引擎；全面的高級驗(yàn)證平臺能夠降低驗(yàn)證復(fù)雜 FPGA 和 SoC 設(shè)計(jì)的風(fēng)險(xiǎn)。 Questa 高級模擬器通過針對 SystemVerilog、VHDL 和 SystemC 的非常激進(jìn)的全局編譯和仿真優(yōu)化算法實(shí)現(xiàn)了業(yè)界領(lǐng)先的性能和容量。

QuestaSim
涵蓋了復(fù)雜 SoC 和 FPGA 設(shè)計(jì)和驗(yàn)證所需的抽象級別，從事務(wù)級建模 (TLM) 到 RTL、門和晶體管。它對多種驗(yàn)證方法提供了卓越的支持，包括基于斷言的驗(yàn)證 (ABV)、開放驗(yàn)證方法 (OVM) 和通用驗(yàn)證方法 (UVM)，以提高測試臺的生產(chǎn)力、自動化和可重用性。
高性能和容量
Questa Advanced Simulator 通過使用其先進(jìn)的算法，可以幫助您將 SystemVerilog 和混合 VHDL / SystemVerilog RTL 仿真性能提高多達(dá) 10 倍。QuestaSim 還支持快速的下一次仿真和有效的庫管理，同時(shí)保持高性能，并具有獨(dú)特的功能，可以預(yù)先優(yōu)化并逐塊定義調(diào)試可見性，從而在運(yùn)行大量測試時(shí)將回歸吞吐量提高多達(dá) 3 倍。

多核仿真
Questa Advanced Simulator 支持所有設(shè)計(jì)語言和結(jié)構(gòu)，可以自動或手動對設(shè)計(jì)進(jìn)行分區(qū)以并行運(yùn)行，同時(shí)維護(hù)用于調(diào)試和覆蓋的單一數(shù)據(jù)庫。

測試臺自動化
Questa Advanced Simulator 支持業(yè)界最全面的測試臺自動化解決方案，可使用 SystemVerilog 或 SystemC 驗(yàn)證 (SCV) 庫結(jié)構(gòu)自動創(chuàng)建復(fù)雜的輸入刺激，并將這些刺激生成形式與功能覆蓋相結(jié)合，以識別自動生成的刺激所執(zhí)行的功能。

基于斷言的驗(yàn)證
基于斷言的驗(yàn)證 (ABV) 通過插入白盒監(jiān)視器來提高設(shè)計(jì)質(zhì)量，這些監(jiān)視器允許在 Visualizer 調(diào)試器窗口內(nèi)主動監(jiān)控功能正確性。斷言會捕獲測試激活但無法傳播到典型黑盒觀察點(diǎn)（例如主要輸出）的錯誤。QuestaSim 通過支持 SystemVerilog 斷言 (SVA) 構(gòu)造和屬性規(guī)范語言 (PSL) 來啟用 ABV。
主要特點(diǎn)和優(yōu)點(diǎn)

業(yè)界領(lǐng)先的高性能多語言仿真器

高效的高級驗(yàn)證解決方案，具有驗(yàn)證管理功能，可實(shí)現(xiàn)大型復(fù)雜電子系統(tǒng)的覆蓋收斂

卓越的調(diào)試 – Questa Visualizer 是西門子的高級調(diào)試解決方案，為您提供完整的調(diào)試功能，包含在每臺 Questa仿真器中

易于使用，通過本機(jī)斷言快速調(diào)試，并提供完整的多抽象和多語言調(diào)試環(huán)境，包括事務(wù)級調(diào)試

約束隨機(jī)刺激生成，實(shí)現(xiàn)測試開發(fā)的自動化

本機(jī)高級 SystemVerilog 測試臺功能與 OVM 和 UVM 相結(jié)合，結(jié)合獨(dú)特的調(diào)試功能，可簡化高級測試臺的開發(fā)和調(diào)試


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